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 Übersetzung für 'Taktzyklus' von Deutsch nach Englisch
NOUN   der Taktzyklus | die Taktzyklen
clock cycleTaktzyklus {m}
1 Übersetzung
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Übersetzung für 'Taktzyklus' von Deutsch nach Englisch

Taktzyklus {m}
clock cycle
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Anwendungsbeispiele Deutsch
  • Insgesamt ergab sich dadurch ein Taktzyklus von 1,6 Mikrosekunden, das entsprach einer Taktfrequenz von 625 kHz.
  • Beim BEDO-DRAM wurde die interne Steuerung des EDO-RAM modifiziert, sodass die Daten mehrerer aufeinander folgender Speicheradressen in einem einzigen Taktzyklus gemeinsam ausgelesen werden können.
  • ... eine ganze Zahl, eine Gleitkommazahl oder einen Opcode) pro Taktzyklus.
  • Eine einfache Hardwareumsetzung von Trivium benötigt 3488 Logikgatter und gibt pro Taktzyklus ein Bit Keystream aus.
  • Gepufferte Module (buffered, registered, fully-buffered) sind beim Zugriff durch die Latenz des Puffers einen Taktzyklus langsamer, dafür sinkt die elektrische Belastung des Speicherinterfaces im Chipsatz bzw.

  • Für jedes Bit an Genauigkeit benötigt der ADU jeweils einen Taktzyklus Umsetzungszeit.
  • Wenn mehrere Ereignisse sehr dicht hintereinander gemessen werden müssen, kommen in der Regel Techniken zum Einsatz, die einen Taktzyklus direkt interpolieren, oft über selbstkalibrierende Gatterverzögerungsketten.
  • Insofern es die Zugriffszeit des angesprochenen Speichers zulässt, kann ein DMA während der ersten Hälfte des Taktzyklus des 6502 stattfinden, da der 6502 nur während der zweiten Hälfte seines Taktzyklus eine Datenübertragung mit dem Speicher durchführt.
  • Skalarprozessoren können maximal einen Befehl pro Taktzyklus ausführen.
  • Die benötigte Zeit ergibt sich aus der Dauer eines Taktzyklus mal die Anzahl der benötigten Taktzyklen.

  • Zu beachten ist, dass einige Hersteller mit einem „Cycle“ oder „Taktzyklus“ nicht die Periodendauer des Taktsignals, sondern ein Vielfaches davon meinen (siehe Double Data Rate).
  • Dies bedeutet jedoch nicht, dass eine Bytemaschine pro Taktzyklus auch nur ein Byte verarbeiten kann.
  • Weil ALUs im Chip jeweils paarweise vorhanden sind, können durch einen vorgeschalteten Multiplexer in einem Taktzyklus zwei Integeroperationen durchgeführt werden.
  • Die Architektur des P6 ist mit ihrer relativ kurzen Pipeline auf eher moderate Taktraten ausgelegt und erreicht ihre Leistung vor allem aufgrund einer hohen Anzahl von Befehlen pro Taktzyklus ("instructions per cycle," kurz IPC).
  • Aber alle Schaltungen weisen konstante und kurze Durchlaufzeiten im Bereich weniger Gatterlaufzeiten meist unterhalb von einem Taktzyklus auf.

  • Die „eigentliche Befehlsausführung“ dauert meist nur 1 Taktzyklus pro Befehl.
  • Mit dem Sockel 423 wurde für den Prozessorbus erstmals von Intel das "Quad-Data-Rate"-Verfahren verwendet, bei dem pro Taktzyklus vier Datenwörter übertragen wurden.
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Enthält Übersetzungen von der TU Chemnitz sowie aus Mr Honey's Business Dictionary (nur Englisch/Deutsch).
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